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AT45DB321C
13.5
Reset Timing
CS
SCK
RESET
SO
SI
HIGH IMPEDA N CE
t REC
t RST
t CSS
HIGH IMPEDA N CE
Note:
13.6
The CS signal should be in the high state before the RESET signal is deasserted.
Command Sequence for Read/Write Operations (except Status Register Read)
SI
CMD
8 bits
8 bits
8 bits
MSB
r X X X XXXX
XXXX XXXX
XXXX XXXX
LSB
Reserved for
larger densities
Page Address
(PA12-PA0)
Byte/Buffer Address
(BA9-BA0/BFA9-BFA0)
Notes:
1. “r” designates bits reserved for larger densities.
2. It is recommended that “r” be a logical “0” for densities of 32M bits or smaller.
3. For densities larger than 32M bits, the “r” bit becomes the most significant Page Address bit for the appropriate density.
25
3387M–DFLASH–2/08
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